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[问答]

山东：戒毒科研专家进场所

163 模数转换器寄存器

问答对人有帮助，内容完整，我也想知道答案 0 您好，我在使用ADS8691作为adc采样芯片，然后在写入范围选择寄存器的时候出现了问题，我尝试写入全一输出的寄存器来测试是否通信成功最终还是只能输出默认的寄存器的转换结果，以下是我的代码使用verilog编写 FPGA输入的外部时钟频率是200mhz，我在代码里采用了八分频。 `timescale 1ns / 1ps ////////////////////////////////////////////////////////////////////////////////// // Company: // Engineer: // // Create Date: 11:34:08 09/19/2022 // Design Name: // Module Name: ads8691 // Project Name: // Target Devices: // Tool versions: // Description: // // Dependencies: // // Revision 0.01 - File Created // Additional Comments: // ////////////////////////////////////////////////////////////////////////////////// module ads8691( input clk_200, input rst_n, input sdo, input rvs, (KEEP="TRUE")output reg sclk, output reg sdi, output reg rst, output reg conv_cs, output [18:0] conv_result ); reg sclk_en; reg[3:0]sclk_cnt; reg [3:0]idle_cnt;//稍微延迟一下下不延迟也没关系 reg [3:0]reset_cnt;//稍微延迟一下下不延迟也没关系 reg [4:0]rd_cnt; reg [4:0]rd_cnt_1; (KEEP="TRUE")reg [17:0]rd_data; wire [31:0]temp; (KEEP="TRUE")reg [5:0]wr_cnt; reg [5:0]wr_cnt_1; (KEEP="TRUE")parameter [31:0]wr_data=32'b10100000000000000000100000101011; // diyiban 11010100000101000000000000001011 // 11001000010010000000000000000000 全1 11010100000100000000000000000101 10100000000000000000100000101011 nop 00000000_000000000_00000000_00000000 reg [7:0]conv_cnt; reg [7:0]rd_cnt1; reg rvs_a; reg rvs_b; wire rvs_neg; wire rvs_pos; (KEEP="TRUE")reg [5:0]adc_state; parameter idle=6'b000001; parameter reset=6'b000010; //parameter acq=6'b000100; parameter rd=6'b001000; parameter wr=6'b010000; parameter conv=6'b100000; always@(posedge clk_200 or negedge rst_n)begin if(!rst_n)begin rvs_a<=1'd0; rvs_b<=1'd0; end else begin rvs_a<=rvs; rvs_b<=rvs_a; end end assign rvs_pos=(~rvs_b)&rvs_a; assign rvs_neg=(~rvs_a)&rvs_b; always@(posedge clk_200 or negedge rst_n)begin if(!rst_n)begin sclk_cnt<=4'd0; end else if(sclk_en)begin if(sclk_cnt==4'd7) sclk_cnt<=4'd0; else sclk_cnt<=sclk_cnt+1'd1; end else sclk_cnt<=4'd0; end always@(posedge clk_200 or negedge rst_n)begin if(!rst_n)begin sclk<=1'd0; end else if(sclk_en)begin if(sclk_cnt==4'd1) sclk<=1'd1; else if(sclk_cnt==4'd5) sclk<=1'd0; end else sclk<=1'd0; end always@(posedge clk_200 or negedge rst_n)begin if(!rst_n)begin conv_cnt<=8'd0; end else if(adc_state==conv) conv_cnt<=conv_cnt+1'd1; else conv_cnt<=8'd0; end always@(posedge clk_200 or negedge rst_n)begin if(!rst_n)begin rd_cnt1<=8'd0; end else if(adc_state==rd) rd_cnt1<=rd_cnt1+1'd1; else rd_cnt1<=8'd0; end always@(posedge clk_200 or negedge rst_n)begin if(!rst_n)begin adc_state<=idle; rst<=1'd1; idle_cnt<=4'd0; sclk_en<=1'd0; conv_cs<=1'd1; wr_cnt<=6'd31; rd_cnt<=5'd31; rd_data<=18'd0; rd_cnt_1<=5'd17; wr_cnt_1<=6'd32; reset_cnt<=4'd0; end else begin case(adc_state) idle:begin if(idle_cnt==4'd15)begin rst<=1'd0; adc_state<=reset; idle_cnt<=4'd0; conv_cs<=1'd1; end else begin idle_cnt<=idle_cnt+1'd1; end end reset:begin //if (rvs_neg)begin // sclk_en<=1'd1; //adc_state<=wr; //reset_cnt<=4'd0; //end if(reset_cnt==4'd1)begin rst<=1'd1; // adc_state<=wr; // //sclk_en<=1'd1; //conv_cs<=1'd0; end else if(reset_cnt==4'd10) conv_cs<=1'd1; else if (reset_cnt==4'd20)begin sclk_en<=1'd1; adc_state<=wr; reset_cnt<=4'd0; end reset_cnt<=reset_cnt+1'd1; end wr:begin if(sclk_cnt==4'd0)begin sdi<=wr_data[wr_cnt]; if(wr_cnt_1>6'd0)begin wr_cnt<=wr_cnt-1'd1; wr_cnt_1<=wr_cnt_1-1'd1; end //else if(wr_cnt==6'd0)begin // wr_cnt<=6'd31; end else if(sclk_cnt==4'd7&&wr_cnt_1==6'd0)begin sclk_en<=1'd0; adc_state<=conv; wr_cnt<=6'd31; conv_cs<=1'd1; sdi<=32'd0; wr_cnt_1<=6'd32; end end conv:begin if(rvs_pos)begin//(\|\|conv_cnt==8'd150) adc_state<=rd; sclk_en<=1'd1; conv_cs<=1'd0; //if(conv_cnt==8'd20)begin // adc_state<=rd; // sclk_en<=1'd1; //end end end rd:begin if(sclk_cnt==4'd1)begin if(rd_cnt>5'd13) begin //rd_cnt_1<=rd_cnt-4'd15; rd_data[rd_cnt_1]<=sdo;//sdo rd_cnt<=rd_cnt-1'd1; rd_cnt_1<=rd_cnt_1-1'd1; end else if(rd_cnt>5'd0)begin rd_cnt<=rd_cnt-1'd1; rd_data<=rd_data; if(rd_cnt_1==5'd0) rd_data[0]<=sdo; end else if(rd_cnt==5'd0) begin rd_data<=rd_data; rd_cnt<=5'd0; end end else if(rd_cnt==5'd0&&rd_cnt1==8'd50)begin//&&conv_cnt==8'd70 rd_cnt<=5'd31; sclk_en<=1'd0; adc_state<=conv; conv_cs<=1'd1; rd_cnt_1<=5'd17; //rst<=1'd1; end end endcase end end assign temp=rd_data; endmodule 我的思路是先写寄存器从高位开始写入命令，然后进入转换最后进行读取操作，然后在读和转换之间来回转换。图中是conv和写状态来回循环第二行的是sdi 第一行是sdo 第三行是sclk 第四行是rvs sdi是写的10100000000000000000100000101011 从低位到高位，但是高位到低位也都试过了也不行。麻烦看看我的问题。谢谢！后续我修改了一下程序这个是我的一个数据帧的波形，最上面是sdo 第二个是sdi 第三行是sclk 第四行是rvs信号，最后一行是cs，写入的命令为10100000000000000000100000101011为11010100000100000000000000000101的高低位互换，请问寄存器应该如何写入呢，我这样写入没有效果，谢谢！ 0 本主题由 Harmony技术专家于 2025-08-05 16:12 审核通过
2025-08-05 06:34:40　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × 新星之火12138 该类别下有 83 个回答。邀请回答 heks 该类别下有 75 个回答。邀请回答 wang21cj 该类别下有 72 个回答。邀请回答普罗旺斯的薰衣草该类别下有 69 个回答。邀请回答 hgimtk 该类别下有 64 个回答。邀请回答 chm5 该类别下有 62 个回答。邀请回答风动影随该类别下有 55 个回答。邀请回答 lksas 该类别下有 54 个回答。邀请回答 zhhx1985 该类别下有 53 个回答。邀请回答站着幻想该类别下有 52 个回答。邀请回答 hfgsd 该类别下有 51 个回答。邀请回答青上也该类别下有 50 个回答。邀请回答 zhouxk 该类别下有 50 个回答。邀请回答 kghfh 该类别下有 50 个回答。邀请回答 blueshine 该类别下有 50 个回答。邀请回答 fdhsfagd 该类别下有 50 个回答。邀请回答你又知道了该类别下有 50 个回答。邀请回答 dsdfshf 该类别下有 49 个回答。邀请回答深海零下一度1 该类别下有 49 个回答。邀请回答 ufydsyfsf 该类别下有 49 个回答。邀请回答举报张超相关推荐 ? ADS8691的输入范围最大是+/-12V，能否在模拟输入端进行调理来扩大输入范围？ 256 ? 将ADS8691作为开关电源的输出电压采样，上到一定电压后ADC会偶尔的暂停RVS信号，为什么？ 268 ? ADS7945数据手册中没有寄存器配置，哪里可以找到？ 354 ? AD9959无法写入寄存器 3683 ? ADS1262寄存器的写入不成功是什么原因？ 377 ? AD5420AREZ无法写入数据寄存器 1651 ? 用IAR调试软件，写入寄存器的数据无法在IAR软件的界面上查询到 4114 ? 使用PCIe DMA无法访问DMA寄存器怎么解决？ 489 ? ADS1255读写寄存器的值不对是哪里出了问题？ 247 ? 使用ads1298时，部分寄存器读写不正常，为什么？ 235 1个回答

答案对人有帮助，有参考价值 0 您好！根据您的描述，您在使用ADS8691作为ADC采样芯片时遇到了写入范围选择寄存器的问题。以下是一些建议和可能的原因： 1. 检查SPI通信协议：确保您遵循了正确的SPI通信协议，包括片选（CS）、时钟（CLK）、数据输入（DIN）和数据输出（DOUT）信号。请参考ADS8691的数据手册以确保您的代码正确实现了SPI通信。 2. 检查寄存器地址：确保您写入的寄存器地址是正确的。ADS8691的范围选择寄存器地址是0x01。请检查您的代码中是否正确设置了寄存器地址。 3. 检查写入数据：确保您写入的数据是正确的。全一输出的寄存器值应该是0xFF。请检查您的代码中是否正确设置了写入数据。 4. 检查时钟频率：您提到外部时钟频率是200MHz，您在代码里采用了八分频。请确保您的时钟频率设置正确，以满足ADS8691的时钟要求。 5. 检查硬件连接：请检查您的FPGA与ADS8691之间的硬件连接是否正确。确保所有引脚都已正确连接，并且没有短路或断路。 6. 调试代码：您可以使用仿真工具（如ModelSim）对您的代码进行仿真，以检查SPI通信是否正确。您还可以使用逻辑分析仪（如Saleae）来检查实际硬件上的SPI通信信号。 7. 检查ADS8691配置：请确保您的ADS8691已正确配置，包括参考电压、增益和滤波器设置。这些设置可能会影响ADC的输出结果。希望这些建议能帮助您解决问题。如果问题仍然存在，请提供更多详细信息，以便我们为您提供更具体的帮助。

2025-08-05 17:18:43 评论举报梁宏满

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